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Design Units
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Design Unit List
Design Unit Hierarchy
Design Unit Members
SsegDisp メンバ一覧
これは全メンバの一覧です。
SsegDisp
継承メンバも含んでいます。
A_n
SsegDisp
[Port]
AN_n
SsegDisp
[Port]
B27segDec
SsegDisp.RTL
[Component]
B27segDeci
SsegDisp.RTL
[Class]
B_n
SsegDisp
[Port]
binary
SsegDisp.RTL
[Signal]
binary0
SsegDisp
[Port]
binary1
SsegDisp
[Port]
binary2
SsegDisp
[Port]
binary3
SsegDisp
[Port]
C_n
SsegDisp
[Port]
clk
SsegDisp
[Port]
clk_frequency
SsegDisp
[Generic]
D_n
SsegDisp
[Port]
decout
SsegDisp.RTL
[Signal]
dot
SsegDisp
[Port]
DP_n
SsegDisp
[Port]
DYNA_DISP_MUX
(ledno, binary0, binary1, binary2, binary3, dot, led_enable)
SsegDisp.RTL
[Process]
E_n
SsegDisp
[Port]
F_n
SsegDisp
[Port]
FreqDiv
SsegDisp.RTL
[Component]
FreqDivi
SsegDisp.RTL
[Class]
G_n
SsegDisp
[Port]
IEEE
SsegDisp
[Library]
led_ena
SsegDisp.RTL
[Signal]
led_enable
SsegDisp
[Port]
ledno
SsegDisp.RTL
[Signal]
lighting_ena
SsegDisp.RTL
[Signal]
logic0
SsegDisp.RTL
[Signal]
logic1
SsegDisp.RTL
[Signal]
nLEDDB
SsegDisp.RTL
[Signal]
nLEDOE
SsegDisp.RTL
[Signal]
reset
SsegDisp
[Port]
std_logic_1164
SsegDisp
[Package]
STD_LOGIC_UNSIGNED
SsegDisp
[Package]
sw
SsegDisp
[Port]
TWO_BITS_BINARY_COUNTER
(reset, clk)
SsegDisp.RTL
[Process]
dynadisp_testに対してThu Mar 6 08:53:59 2008に生成されました。
1.5.5